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串行I/O2控制寄存器1中,P01/SOUT2,P02/SCLK2P沟道输出禁止位设至CMOS输出时SOUT2变高阻抗?

最新更新:06/09/2005

Question:

(串行接口) 数据表或用户手册中,串行I/O2时序图的注释指出“传送时钟选择内部时钟时,SOUT2引脚在传送后进入高阻抗状态。” 串行I/O2控制寄存器1中,P01/SOUT2,P02/SCLK2 P沟道输出禁止位设至CMOS输出时(输出模式),SOUT2引脚是否进入高阻抗状态?
此外,何时进入高阻抗状态? [2005/06/09]

Answer:

传送时钟选择内部时钟时,SOUT2引脚是否进入高阻抗状态与P01/SOUT2, P02/SCLK2 P沟道输出禁止位的设定无关。
上一次传送时钟上升开始的半个周期后,SOUT2引脚进入高阻抗状态。
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